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作者Email: zk197911@yahoo.com.cn [摘 要] 介绍了一种新型铁电存储器FM18L08，同时还分析了TMS320VC5402 DSP的并行引导装载模式，给出了一种基于铁电存储器FM18L08的DSP脱机独立运行系统的设计方案，并且该方案已成功的应用到一种语音门锁系统中。 [关键词] DSP；铁电存储器；并行引导装载模式 1 引 言 铁电存储器（FRAM）是Ramtron公司近年推出的一款掉电不挥发存储器，它结合了高性能和低功耗操作，能在没有电源的情况下保存数据。FRAM克服了EEPROM和FLASH写入时间长、擦写次数低的缺点，其价格又比相同容量的不挥发锂电SRAM低很多，已在地铁系统、抄表系统及IT工业中得到了广泛的应用。 TMS320VC5402（以下简称C5402）是美国德州仪器公司（TI）推出的一款性价比极高的16bit定点数字信号处理器（DSP），操作速率可达100MIPS，它丰富的内部资源配置为用户构造系统提供了很大便利，已经在通信、电子、图象处理等领域得到了广泛的应用。但是，C5402是RAM型器件，掉电后不能保持任何用户信息，所以需要用户把程序代码放在不挥发的存储器内，在系统上电时，通过执行自行引导装载（Bootloader）程序将存储在外部媒介中的代码装载到C5402高速的片内存储器或系统中的扩展存储器内，装载成功后自动去执行代码，完成自启动。 2 FM18L08 FRAM的特点 Ramtron’s FRAM存储器技术的核心是微小的铁电晶体集成到记忆体单元，以至于它能象快速的不挥发RAM一样操作。 当一个电场被加到铁电晶体，中心原子顺着电场的方向移动。 移去电场，中心原子保持不动，保存记忆体的状态， FRAM 记忆体不需要定期刷新，掉电后立即保存数据。 FM18L08是Ramtron公司近年推出的一款存储容量为32k╳8bits FRAM，其主要特点如下：3.0-3.65V单电源供电；并行接口；提供SOIC和DIP两种封装；功耗低，静态电流小于15uA，读写电流小于10mA；非挥发性，掉电后数据能保存10年；读写无限次。 FM18L08引脚结构如图1： 3 C5402并行引导装载模式设计 3.1 C5402系统的程序引导装载模式类型： C5402提供以下几种引导装载模式类型： ① HPI（主机接口）引导装载模式 欲执行的程序代码通过主机接口总线由外部处理器加载至DSP片内存储器中。当外部处理器将被加载代码的起始地址（C5402片内地址007FH）的内容改变，便开始执行引导装载程序。 ② 8位/16位并行引导装载模式 引导装载程序通过外部并行接口总线读取存放在外部数据存储单元中的数据。外部数据单元中的数据是按照一定格式存储的，其信息包括：欲加载的各段程序代码、各段程序代码长度、各段程序代码存放的目标地址、程序代码的入口地址以及其他配置信息。 ③ 8位/16位标准串行口引导装载模式 引导装载程序通过被设置为标准模式的多通道缓冲串口（McBSP）读取存放在外部数据存储单元中的数据。多通道缓冲串口1（McBSP1）支持8位串行接收方式，多通道缓冲串口0（McBSP0）支持16位串行接收方式。 ④ 8位串行EEPROM引导装载模式 引导装载程序通过一串联的EEPROM读取存放在外部数据存储单元中的数据。在此种方式中，EEPROM与设置为SPI工作模式的McBSP1相连接。 ⑤I/O引导装载模式 引导装载程序通过外部并行接口总线地址为00H的I/O口读取数据。该外部并口接口总线使用异步握手协议（使用C5402的XF和BIO引脚），使数据传输速度可按外部存储器设备的要求执行。 3.2 C5402并行引导装载模式设计 对于以C5402为核心的数字信号处理系统来说，并行引导装载模式被认为是最适用的。因为HPI引导装载模式、标准串行口引导装载模式和I/O口引导装载模式只适用于由其它处理器为C5402提供运行代码的多处理器系统中，串行EEPROM引导装载模式只支持价格偏高的SPI端口EEPROM，而并行引导装载模式可采用的并行EEPROM和Flash种类很多，有的价格比较低，操作起来比较简单，因而并行引导加载方案是最佳选择。 为使C5402能有效地把外扩FRAM中的程序引导到芯片内RAM，需要编制一个引导表。引导表定位于数据空间的4000h～FFFFh段，引导表的内容包含如下几个方面：（1）引导方式的标识；（2）程序存放的目标首地址；（3）程序执行的入口址址；（4）用户程序代码；（5）用户程序块长度。引导表结构如表1所示。
表1并行引导装载模式引导表 片内ROM的引导程序首先读取I/O空间的FFFFh地址内容（指定为8000h）作为引导表的起始地址，通过判别引导表起始地址内的引导标识来确定是8位并行还是16位并行引导方式。若引导标识是10AAh，则是16位的并行引导方式；若引导标识是08AAh，则是8位的并行引导方式。当从I/O空间FFFFh地址读取不到有效的引导标识时，片内ROM的引导程序即读取数据空间FFFFh的内容作为引导表的起始地址。同样通过判别引导表起始地址内的引导标识来确定是8位并行还是16位并行引导方式。当EPROM数据位宽是8bit时，则要读取数据空间FFFFh地址的内容（低字节）和FFFEh地址的内容（高字节）作为引导表的起始地址。 8bit 并行引导装载的实现电路如图1所示。其中A15经过非门与/MSTRB相或是为了防止C5402的内部16K DARAM（0000H-3FFFH）与外部FRAM冲突，同时，对应上并行引导装载模式的引导表设置相对应。
图1 硬件系统原理图 4系统软件设计 这个系统中，软件编程的核心在于按照特定的格式将数据写到FM18L08 FRAM中，下面具体介绍软件系统的设计方法。 在TI公司的软件开发工具CCS（Code Composer Studio）中，汇编器和连接器创建的目标文件采用COFF（Common Object File Format）格式，代码和数据都按段（Section）来组织设计。先通过CCS将程序下载到硬件系统的C5402的片内DARAM中，再运行程序将所需数据及程序按照表1的格式写到FM18L08 FRAM（对应于DSP数据寻址的08000h—0FFFFh）中，断开硬件系统与CCS环境的联系，重新上电或复位C5402，将看到灯在闪烁，此时硬件系统已经可以脱机独立运行了。 .mmregs 主程序中，data段为上电引导程序提供了需要加载的各代码段的长度、源地址和目的地址这几个参数。其中，代码段长度既可以根据载入DSP系统后在CCS反汇编窗口算得，也可以从连接生成的映像文件（后缀为.map）中得到。 5 结束语 本文介绍的基于铁电存储器FM18L08的DSP 并行引导装载方案，可以在无需专用烧写器的情况下，实现DSP脱机独立运行系统的设计，并且该方案已成功的应用到一种语音门锁系统中。实验结果表明，该方法具有简化接口电路、节省系统资源、性价比高的优点。 但是，如果脱机独立运行系统程序超过了64K字节，只能采用另外的替代方法，这是在一些电路设计方案论证时需要考虑的问题。 作者Email: zk197911@yahoo.com.cn |
