CCD水平驱动脉冲的周期和脉宽是固定不变的，而六相垂直驱动脉冲却是变化多样，每相垂直驱动脉冲的上升沿和下降沿时刻均会有所不同，在这里通过四个步骤设置AD9995中相应的寄存器组来产生CCD所需要的驱动脉冲。第一步通过VPAT0～VPAT9这10个寄存器组产生多至10组不同垂直驱动脉冲组合(如图4所示),每一种组合中的垂直驱动脉冲V1～V6的上升沿和下降沿时刻均可分别定义。等二步在第一步定义的脉冲组合的基础上组成不同垂直脉冲序列V－SEQUENCE(如图5所示)。对应一个垂直脉冲序列选择一组垂直脉冲组合，并定义垂直脉冲组合在垂直脉冲序列中的起始时刻以及重复次数。第三步为一场(FIELD)图像中的不同区域指定相应的垂直脉冲序列(如图6所示)。每一个场图像可以包含多达7个不同的区域(RIGEON)；至多可以定义6个不同的图像场。最后通过模式寄存器的设置把不同的场组成图像输出(如图7所示)。在ICX432DQF的帧输出模式中，根据驱动脉冲要求，分别定义5组垂直脉冲组合、5组垂直脉冲序列、3个图像场，最后通过模式寄存器把这些驱动信号整合。
　　在驱动脉冲的作用下，从CCD输出的像素模拟电压信号由CCDIN引脚输送到AD9995的DIN引脚，经AFE采样、放大和A/D转换后，由DOUT引脚以12位数字量输出。
2.3 DSP及高速图像数据的存储
　　由于图像的数据量非常巨大，而且要以24MHz的高速率将每一像素的数据输出，所以高速图像数据的实时存储是图像采集系统的关键环节。本系统采用ADI公司新近推出的ADSP-BF533高性能数字信号处理芯片及外接SDRAM存储器来实现图像数据的传输与实时存储。通常为使CCD输出的高速数据流与外部总线接口较低的传输速度相匹配，必须使用FIFO作为数据缓冲器，之后再由DSP读取。然而，利用ADSP_BF533系列DSP芯片中的PPI(Parallel Peripheral Interface)却可以很容易地实现DSP与高速ADC和DAC的无缝连接。通过PPI和DMA的组合使用，可以有效地获取、存储和传输图像数据，大大减少了实时图像处理应用中内核处理器的开销，可编程和可设置性也减少了外部元器件。在系统中，由AD9995并行输出的高速数据送到DSP的PPI，并在直接存储控制器(DMA)的控制下写入SDRAM存储器。

2.3.1 PPI接口功能与原理
　　ADSP_BF533芯片提供的PPI是一种多功能并行接口，数据线宽度可以在8位～16位之间设置。PPI支持双向数据流，能够与高速A/D转换器、D/A转换器或其它通用外围设备直接并行连接，适合大量数据的高速连续输入与输出。它包括三条同步信号线和一个与外部时钟相连的时钟引脚。在本系统中，PPI时钟由AFE9995的像素输出时钟DCLK驱动，PPI可以在驱动时钟频率高达65MHz的情况下接收数据，所以完全能够满足本系统中CCD 24MHz速率的像素数据传输。根据经A/D转换后的数据宽度设置PPI的数据线宽度为12位，由AD9995输出的水平同步信号HD和垂直同步信号VD分别输入PPI的PPI_FS1和PPI_FS2同步信号引脚(如图8所示)。
　　从CCD输出的像素信号并不都是有用的，每一行中在有效像元前后都存在一些黑(OPTICAL BLACK)像素，和一些哑(DUMMY)像素，同样在一场有效输出前后也存在着一些哑行，所以由AFE输出的有效图像数据中间有一定的行间隔和场间隔。当HD同步信号输入到PPI的FS1后，需要等待若干时钟周期才开始有效像元数据的传输，这时可通过延迟计数寄存器(PPI_DELAY)来设置需要等待的时钟周期数。另外，还要在PPI_COUNT和PPI_FRAME寄存器中分别设定每一行的像素数和每一场图像的行数，这样便确定了每一次PPI调用中所要传输的数据量。

2.3.2 DMA的调用
　　在CCD数据采集这种数据量非常大的情况下，PPI 接口只有在DMA引擎的配合下，系统才能发挥它的高效能。虽然对图像数据进行的传输也可由软件实现，但将消耗掉大量的CPU时钟周期，使DSP的高速数据处理能力难以发挥。因为有了DMA独立负责数据传输，在系统内核对DMA初始设置并启动后，便不再需要内核参与，DMA控制器直接把图像数据从PPI接口传输至SDRAM存储器进行存储。于是，在有效地解决了大批量图像数据传输这一速度瓶颈的同时，又能让DSP处理器专心从事算法处理工作，极大地提高了系统的并行性能。
　　ADSP-BF533的DMA可以控制六种类型的数据传输：内部存储器之间、内部存储器－外部存储器、存储器－SPI接口、存储器－SPORT接口、存储器－UART接口、存储器－PPI接口。本系统使用PPI接口与外部存储器SDRAM之间的DMA传输。DMA的建立需要如下步骤：(1)设置寄存器DMA1_0_START_ADDR_REG，写入目标地址值；(2)设置寄存器DMA1_0_X_COUNT_REG，写入传输次数；(3)设置寄存器DMA1_0_X_MODIFY_REG，写入每次数据传输的目标地址修正值；(4)设置DMA控制寄存器DMA1_0_CONFIG_REG，启动DMA数据传输。
3 系统软件实现
　　在ADI 公司的DSP集成开发环境Visual DSP++3.0中，采用C语言与汇编语言混合编程的方式进行CCD图像采集的软件开发。系统软件流程图如图9所示。系统初始化之后，调用AD9995设置子程序对AD9995中的众多寄存器组进行设置，使其能够产生所要求的CCD驱动脉冲；之后检查DMA通道是否空闲，若通道忙则等待，若空闲则对PPI和DMA通道的相关寄存器进行设置，并且使能PPI和DMA通道，这样当PPI接口收到HD脉冲后便启动了数据传输。

该CCD图像采集系统采用集成了模拟前端电路与时序发生器的集成元件，从而保证系统具有更高的可靠性和较强的抗干扰能力；通过软件可以方便地改变时序发生器的驱动脉冲，因此适用于多种不同型号的CCD器件，具有较好的通用性。利用PPI和DMA完成数据的传输与存储，改变了通常在高速ADC和DSP之间通过FIFO存储器连接的方式，实现了高速ADC和DSP的无缝连接，简化了系统结构。基于以上特点，本CCD图像采集系统很适合应用于数码相机以及对分辨率要求较高的图像采集与处理场合。