Figure 2 – JESD204A Interface

　　图2——JESD204A接口

　　目前，NXP半导体提供的CGVTM数据转换器上的JESD204A接口是一种高速串行接口，使用兼容CML的差分信号和8B/10B编码。目前的最高数据速率为3.125 Gbps，通过数据转换器和FPGA之间的多路通道实现任意大小的系统带宽，实现每个通道带宽超过312.5兆字节/秒的数据速率。由于JESD204A支持精确的跨线同步，它本身还支持正交采样，这对于以OFDM调制机制为基础的3G和4G空中接口来说是非常必要的。基于SERDES的数据转换器和FPGA的优势

　　可编程逻辑和高速数据转换技术在基站设计的整个演变过程中发挥了非常重要的作用。数据转换器提供了射频功率放大器与无线通信单元中射频小信号部分的桥接，而FPGA为设计师们提供了足够的灵活性，使得在空中接口规范完全确定之前就可以开始设计。

　　日益增加的基站数据吞吐量的需求导致了无线通信单元的元件成本和功耗的增加，并使得相关印刷电路板和接口更加复杂，同时更加强调对信号完整性的要求。兼容了JESD204A的数据转换器，具有降低元器件材料成本及其他商业和技术方面的优点，使得BTS的OEM厂商无法忽略这个新型、具有突破性意义的接口选择。不断节约的元器件材料成本很快超过了采用该接口技术的花费，并且还提高了系统的可靠性，从而进一步节约了成本。

　　JEDEC JESD204A通过简化印刷电路板布局大大地降低了射频拉远单元的元器件材料成本，印刷电路板布局的简化在减少了电路板层数的同时缩小了电路板尺寸，这两者都是增加电路板成本的重要因素。此外，由于JESD204A大大降低了数据转换器和FPGA之间的接口信号数量，从而使得整个系统的可靠性得到增强。由于低电压摆幅的CML降低了功耗，电源的元器件材料成本也可能相应地减少。JESD204A除了有助于降低元器件材料成本，还对设计的系统架构级有很大的益处。强大的嵌入式协议(没有软件开销)，包括数据加扰、单比特错误检测和数据线路同步丢失检测，以及加强了射频印刷电路板上模拟和数字部分的隔离，提高了抗噪声能力。许多业内观察员认为数据转换接口向JESD204A的转换是不可避免的，就像在PC和DSP硬件领域中向USB、PCI Express和串行RapidIO高速串行的转换一样。

　　正如数据转换器那样，对于成本、功耗和性能的更高要求也迫使FPGA架构发生重大改变，从而显著地提高了其性能、特性和逻辑密度。与ASIC相比，FPGA因其本身的灵活性和更快的产品上市时间，长期以来一直广受赞誉，但是过去FPGA仅限用于“接口逻辑”和“修正错误”的应用。如今由于FPGA的价值已大大扩展，这一情况已经发生改观。例如，莱迪思低成本、低功耗的新型FPGA系列，具有增强型功能，如集成的SERDES、DSP的数据通路和嵌入式存储器，已经成为了众多射频拉远单元设计的重要组成部分。系统设计工程师们现在仅需花费一半的功耗和成本，利用这款极具竞争力的带有SERDES功能的FPGA，在复杂的信号路径应用中使用这个可编程平台，实现诸如数字下变频(Digital Down Conversion，DDC)、数字上变频(Digital Up Conversion，DUC)、波峰因数缩小(Crest Factor Reduction，CFR)和数字预失真(Digital Pre-Distortion，DPD)功能。

　　小结

　　BTS的OEM厂商需要认真考虑，使用新的JESD204A高速串行接口为射频拉远单元节省元器件材料成本和其他费用，以作为应对未来不断增加的无线基础设施ASP的降价压力的一种重要手段。

　　过去，FPGA和数据转换器在射频拉远单元设计中发挥了关键作用;如今，它们在降低系统构建成本上发挥着更大的作用。基于SERDES的、可扩展的JESD204A接口在多个ADC / DAC和多个FGPA之间提供了一个无缝、简化的、低功耗和低成本的数据高速公路。功能丰富、更低成本的FPGA实现了更快的产品上市时间和更短的成本收回周期，并提供能够更有效地应对不断变化的标准的灵活性。系统设计工程师现在还拥有一个令人兴奋的、改进的工具集来应对不断发展的无线宽带市场的挑战。

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