NC（1，21，27，28，33，37脚）：悬空；

PAG0～PGA4（2～6脚）：PGA和多路复合控制输入，在重启或硬件模式时，可用来设定CB0-CB4的逻辑电位和结构寄存器中相应的状态位；

BW0～BW2（7～9脚）：输出率控制端，在重启或硬件模式时可用于设定数字滤波器的抽样率和结构寄存器中的相关状态位；

H/S（10脚）：硬/软件模式选择端口，高电平时为硬件工作模式，低电平时，器件被设置为向结构寄存器的写时序或连续写时序；

VL（11，22，44脚）：数字电源，额定3.36V或5V；

DGND（12，23，24，34脚）：数字地；

SCLK（13脚）：串行数据时钟输入端，可用于使DIN引脚的写信号操作和DOUT引脚的读信号操作同步传输；

DOUT（14脚）：串行数据输出，在读操作的开始时开始输出，在SCLK的上升沿时数据改变，且在SLCK下降沿之前有效；

DRDY（15脚）：数据就绪，输出为高电平时，数据准备进入输出数据寄存器；输出为低电平表示读操作完成；

CS（16脚）：片选端，为低电平时，引脚DIN、DOUT、和SCLK被激活；为电平时，这些引脚无效；

R/W（17脚）：读/写选择，设置为高电平且CS为低电平时，激活读操作；设置为低电平时，可由DIN引脚进行写操作；

RSEL（18脚）：寄存器选择，设置为高电平时，数字寄存器的转换结构由DOUT引脚输出；设置为低电平时，状态寄存器的内容由DOUT引脚输出；

DIN（19脚）：串行数据输入，在读操作时，可由输入转换寄存器向结构寄存器载入，人最高位开始，在SCLK下降沿有效；

ERROR（20脚）：错误标志，输出为低电平时，表示在调制器或数字滤波器中有错误存在，此时状态寄存器ERROR位置1；

RESET（25脚）：滤波器重启，输入高电平时，把状态寄存器的有关错误位清零，并设置结构寄存器中有关硬件引脚的状态位（此操作应在供电状态下进行）；

PWRDN（26脚）：掉电硬件控制，PWRDN为高电平且SLKIN处于第一个下降沿时，处于掉电模式；

SCEL（29脚）：滤波器输入选择，该脚为高电平时，TDATA引脚作为数字滤波器的数据输入；该脚为低电平时，MODATA引脚作为输入；

TDATA（30脚）：测试数据输入端，输入测试数据到滤波器；

SYNC（31脚）：同步输入，通过该引脚为AD1556数字滤波器清零，以便和滤波器卷积同步；

CLKIN（32脚）：时钟输入，额定频率为1.024MHz；

MCLK（35脚）：调制器时钟，用于提供调制器抽样频率，以CLKIN频率的1/4抽样；