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基于FPGA的USB2.0虚拟逻辑分析仪的设计与实现
来源:本站整理  作者:佚名  2010-04-09 11:28:23



  使用并行触发方式,可以选择最多八级的并行触发。在进行触发设置时,除设置触发方式(选择并行触发)和进行频率选择以外,还需要进行触发字、屏蔽位和并行深度的设置。其Verilog HDL算法源程序如下:

  if ((({dbuf4[0],dbuf3[0], dbuf2[0],dbuf1[0]}^ TrigWord [dcount] )&enbit[0] ) == 4'h0)

   begin

   if(dcount[2:0]==control[4:2])

   begin

   TrigFlag=2'b01; Trigpoint[6:0] <= MemABus_Wr[6:0]; 

       dcount="3"'b000;     end

     dcount = dcount+3'b001;

       end

  其中,dbuf4、dbuf3、dbuf2、dbuf1分别为采样通道4、3、2、1的数据缓存;TrigWord[dcount]为触发字;dcount为触发深度计数器;control[4:2]为设定的触发 
深度;enbit[0]为屏敝字;Trigpoint为触发位置寄存器。

  USB2.0接口设计

  本设计选用符合USB2.0规范的CP2102芯片构建系统与PC的通信接口。

  CP2102是USB-UART桥接芯片。该电路内置USB2.0全速功能控制器、USB收发器、晶体振荡器、EEPROM及异步串行数据总线,支持调制解调器全功能信号,无需任何外部的USB器件。其功能强大,采用MLP-28封装,尺寸仅为5mm×5mm,占用空间非常小,非常适合大数据量处理与传输电路系统的设计与应用。

  实际应用中,系统只需使用CP2102基本的输入/输出数据线与复位信号线。其接口原理如图2所示。

  系统启动时, 单片机RB1端口发送一低电平至CP2102复位端,芯片复位,然后保持复位端高电平,CP2102正常工作。

 USB2

图2 USB2.0接口电路图

  由于CP2102内部的透明设计,数据通信时,可以不必构建CP2102与单片机的握手信号;CP2102数据线直接与单片机1#USART模块的接收移位寄存器(RSR)和发送移位寄存器(TSR)相连。CP2102数据线上一旦出现待发送的数据,该数据会自动移入单片机接收移位寄存器;同样,单片机发送数据时,发送移位寄存器中的数据直接移至CP2102的数据线(即USB接口数据线)上。

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