2．3．2 地址的生成
    在逻辑控制设计完成后，将最后得到的25MHz的时钟输入17位计数器，每次上升沿到来，地址加1，生成的地址信号使得采集的信号存入对应的地址单元。使用Q9位是为了让输出端可以产生低电平，从而在采集的数据到达所需个数时有一个上升沿来触发其所控制的触发器，使得数据采集暂停，等待下一次采集；12作反馈，它指示的是数据采集到了4k，通过它进行反馈，用它停止A／D芯片的工作，同时将地址计数器清零，准备数据读出；最后，存储够了4k的数据，AD_0E输出高电平，用于控制A／D芯片和内部地址计数器，可以看到地址计数器在数据采集到达4K后也清零，在初始的位置等待数据的读出。系统控制原理图如图6所示。系统仿真结果(仿真图略)表明，该设计可以满足本系统要求。

3 总结
    本系统是一种在单片机控制下完全靠硬件通过多次低速数据采集，然后进行波形拼凑，实现达到100MHz频率的高速数据采集与存储的系统，采集数据最多可达到128k，具有硬件成本低廉，性能价格比较高的优点，该系统的数据采样频率完全不受单片机速度的影响，而只取决于所选用的A／D转换电路的速度和控制逻辑的设计，其测量结果准确度高，对温度、湿度等环境指标要求不高，环境实用性强，在生产实践中可有效解决电缆断点测定的难题。