4 测试结果
    QuartusⅡ6．0是Altera FPGA／CPLD的综合性集成设计平台。该平台集成了设计输入、仿真、逻辑综合、布局布线与实现、时序分析、芯片下载与配置、功率分析等几乎所有设计流程所需的工具。Verilog HDL程序在QuartusⅡ6．O环境下编译、仿真和下载，板级标签经过总体设计、PCB板设计与实现、代码设计、仿真与下载，以及系统调试后，能够与支持ISO18000-6C标准的读写器(Cetc7 Rlid Reader V 1．O)进行通信，快速准确地收发信息，并实现防冲突功能。图3显示板级标签能够解码来自阅读器的命令信息，在状态机的控制下，正确地输出FM0编码信号。图4显示板级标签能够支持ISO18000-6C标准的阅读器正确读取(读取到的EPC码与标签一致)，读取效果良好(73次／10 s)，读取性能稳定。测试表明，板级标签能够实现ISO18000-6C标准中的读写功能，标签工作性能稳定，可靠性都能达到预期的效果。

5 结 语
    根据ISO18000-6C标准，采用EP1C6Q240FPGA以及模拟射频分立元件，经过总体设计、PCB板设计与实现、代码设计、仿真与下载，以及系统调试后，完成了基于FPGA的板级标签的软、硬件设计与实现。该系统通过测试，已能够正常工作，读写性能优异，并实现了防冲突功能。在此基础上可以进一步提高其安全性和可靠性，所设计的标签数字电路RTL代码能够直接应用到标签芯片开发中，为下一步设计出符合该标准的电子标签芯片提供了有力的保证。