4 三阶高密度双极性编码的仿真
    在此以四连“O”的可能情况进行如表1的多“0”消息代码进行分析，利用EDA工具对硬件描述语言源程序进行编译、适配、优化、逻辑综合与仿真，其仿真结果达到了编码要求，仿真图如图10所示。将三阶高密度双极性编码硬件描述下载到CPLD或FPGA目标芯片中，连接好CC4052进行实际应用测试，用示波器测得编码波形如图ll所示，完成了实际转换需求。

5 三阶高密度双极性译码的仿真
    在此以消息代码“111000011000011101”进行分析，利用EDA工具对硬件描述语言源程序进行编译、适配、优化、逻辑综合与仿真，其仿真结果达到了编码要求。仿真图如图12，图13，图14所示。将三阶高密度双极性译码硬件描述下载到CPLD或FPGA目标芯片中，连接好双／单极性变换电路及时钟提取电路进行实际应用测试，用示波器测得译码输出波形如图14所示，完成了实际译码需求。

6 结语
    将基于硬件描述语言的三阶高密度双极性编译码IP核实现在光通信等系统中，能满足实际上测试的需要。且运用基于硬件描述语言的可编程芯片开发技术，将信号处理的相关电路进行硬件描述，用CPLD／FPGA技术实现数字通信系统，不仅可以通过芯片设计实现多种数字逻辑功能，且由于管脚定义的灵活性，提高了工作效率，极大地减少了电路设计的时间和可能发生的错误，降低了开发成本。