系统仿真

　　在该系统中，状态机设计是难点，图5是运用Active-HDL7.1仿真工具的状态机仿真结果，仿真时，采用7.375MHz时钟同步，状态机启动后，计数寄存器里的数据递减，进而产生各状态转移满足的条件，以此实现状态机的翻转。

　　在Active-HDL7.1中编写TestBench文件时，通过向组帧状态机计数寄存器写数，来控制各状态所占用的时间，利用 StartMakeFrame信号高电平启动状态机，各状态发生翻转时，状态完成标志就产生产生高电平跳变。

　　根据图5的仿真结果，可以看出组帧状态机工作正常，所有的逻辑关系也都验证无误。

结语

　　本文采用FPGA设计实现高速图像采集系统，并采用LVDS接口实现接收与发送，各种模块之间通过缓存实现通信,避免图像的丢失;采集的图像类型和图像尺寸可以通过软件重新配置FPGA进行调整。总之，基于FPGA 的高速专用图像采集系统电路集成度高、信噪比高、功耗低、成本低、速度快以及接口方便，所设计系统采用两帧切换存储方式，使得后续的其它图像处理模块能够与图像采集模块并行工作，为图像处理器的高度集成化实现提供了可能性。