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基于FPGA快速A 律压缩编码的设计与实现
来源:本站整理  作者:佚名  2010-04-09 11:34:01



4.1状态机(state)

为了使comp模块间有序进行工作,确保之间数据正确稳定的传输,特引入状态机对各模块进行数据读、写控制。                                                                                                              

4.2比较单元(compare)


图3 comp单元流程图(段内码单元)


                      图4 comp单元流程图(段落码单元)

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