设计时，THSl2082通过插座JDSP连接到EMIFB，片选信号CSO与BCE2相连，将THSl2082配置在EMIFB的BCE2中；THSl2082读写控制信号RD、WR(R／W)分别接EMIFB的BARE、BAWE；AINP、AINM为模拟输入通道；外部输入参考电压的正负极REFM、REFP分别通过电容接地；由于THSl2082的REFOUT为2．5V参考电压输出，将REFIN引脚接至REFOUT引脚，实现2．5 V标准电压的输入；DATA_AV数据有效信号与DSP的EXT-INT4相连，数据采集FIFO存满后，申请中断通知DSP读取数据；THSl2082溢出信号OV_FL与DSP的EXT-INT5相连，表示有溢出，这时应处理溢出处理；12位数据线接EMIFB的BED[15：0]的低12位；A／D时钟通过J_CLK插座接DSP的TOUTl定时器输出，通过对DSP内部定时器Timerl的编程产生8 MHz采样时钟，并根据采样要求调整。THSl2082与TMS320C6416的接口电路如图3所示。输入信号时，系统可通过J_AINP或J AINM输入，经运算放大器AD8042AR将信号变换到THSl2082采样范围1．5~3．5V内进行采样，也可选择通过J_DIF输入，选择差分模式采样信号。

3．2 数据存储电路设计
    TMS320C6416T的EMIFA为64位存储器总线，分成4个存储空间ACEO~ACE3，每个存储空间可独立配置，无缝接口具有多种类型的存储器(SRAM、ROM、SDRAM等)。EMIFA工作时钟有：AECLKIN(外部输入)、CPU时钟四分频(250 MHz)、CPU时钟六分频(167 MHz)。EMIFA接口信号如图4所示。该系统设计选用同步存储器SDRAM HY57V2—83220T，其容量为2 Mx32位。该器件的32位数据线与EMIFA的64位数据总线AED[0：63]的低32位AED[0：31]相连；12位地址线接EMIFA的20位地址总线的AEA[3：14]；片选信号CS接EMIFA的ACEO，将SDRAM配置在ACEO空间中；列、行地址选通信号CSA、RAS接EMIFA的ASDCAS、ASDRAS；信号WE接EMIFA的写使能信号ASDWE；HY57V283220T的时钟由AECLKOUTI提供，并与EMIFA的时钟相同；CKE接ASDCKE，SDRAM时钟使能，其接口电路如图5所示。