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基于Verilog HDL滤波器的设计
来源:本站整理  作者:佚名  2011-08-21 20:05:02



  计算控制器用于控制滤波单元中移位寄存器移位,累加器的循环周期和计算输出,并控制移位寄存器的数据输入。

  2 利用VerilogHDL语言实现以上功能

  2.1 用VerilogHDL语言进行算法建模

  计算机控制器的veril—ogHDL模型:

  寄存器组中每个寄存器的位数为0,1,…,num一1。

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